Validación del uso de aritmética distribuida en la implementación de redes neuronales


Authors

  • Andrés E. Gaona Barrera

Abstract

En este documento se presentan algunos resultados del uso de aritmética distribuida enfocados hacia implementaciones hardware de redes neuronales, dichos resultados confrontan consideraciones de área vs. precisión, a tener en cuenta por parte del diseñador antes de llevar la arquitectura de su red neuronal a algún dispositivo (microcontrolador, dispositivos de lógica programable o DSPs). El algoritmo desarrollado brinda un estimativo de cuánto se penaliza la precisión de la red a nivel hardware a medida que aumenta el número de bits empleados para representar las entradas. Además posee la ventaja que ejecuta las operaciones de manera digital emulando operaciones reales como se efectuarían en FPGA o CPLD, lo cual posteriormente puede ser utilizado para extraer el código para programar estos dispositivos.

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Published

2007-05-30

How to Cite

Gaona Barrera, A. E. (2007). Validación del uso de aritmética distribuida en la implementación de redes neuronales. Scientia Et Technica, 1(34). Retrieved from https://revistas.utp.edu.co/index.php/revistaciencia/article/view/5537

Issue

Vol. 1 No. 34 (2007)

Section

Eléctrica

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